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1、隨著電子技術(shù)的不斷發(fā)展,雷達(dá)所面臨的電子對(duì)抗環(huán)境愈發(fā)激烈。為了獲得強(qiáng)的抗干擾和生存能力,使用數(shù)字方式來合成雷達(dá)波形顯得尤為重要,數(shù)字方式合成的波形具有嚴(yán)格的相干性、可重復(fù)性、穩(wěn)定性高和可編程的優(yōu)點(diǎn),并能實(shí)現(xiàn)波形參數(shù)捷變及產(chǎn)生任意波形,因此對(duì)雷達(dá)波形數(shù)字產(chǎn)生技術(shù)的深入研究具有十分重要的現(xiàn)實(shí)意義。
本文圍繞某高速任意波形產(chǎn)生器的研制,運(yùn)用目前比較先進(jìn)的SOPC技術(shù)和直接數(shù)字頻率合成技術(shù)(DDS)完成了該波形產(chǎn)生器軟件部分的設(shè)計(jì)開發(fā)
2、。針對(duì)該波形產(chǎn)生器高速率的特點(diǎn),采用了非易失性存儲(chǔ)器FLASH結(jié)合高速緩存SDRAM以及高速DAC的硬件結(jié)構(gòu)來實(shí)現(xiàn)。同時(shí)根據(jù)系統(tǒng)設(shè)計(jì)要求,該波形產(chǎn)生器不僅能輸出多種NLFM、單載頻脈沖壓縮信號(hào)及其它任意波形,還需具有產(chǎn)生一定頻帶和脈寬范圍內(nèi),任意帶寬、任意中頻、任意脈寬的線性調(diào)頻信號(hào)(LFM)的功能,因此本文在進(jìn)行軟件和邏輯設(shè)計(jì)時(shí)運(yùn)用了以下幾種技術(shù)方法來滿足上述要求。首先根據(jù)系統(tǒng)硬件結(jié)構(gòu)采用了基于直接數(shù)字波形合成技術(shù)(DDWS)+高速D
3、AC的設(shè)計(jì)方案來實(shí)現(xiàn)任意波形的產(chǎn)生,并完成了邏輯設(shè)計(jì)與軟件仿真;其次針對(duì)線性調(diào)頻信號(hào)參數(shù)任意可變的特點(diǎn),以及出于系統(tǒng)存儲(chǔ)容量的考慮,采用了在該硬件平臺(tái)上直接利用FPGA內(nèi)部數(shù)控振蕩器(NCO)資源來實(shí)時(shí)計(jì)算產(chǎn)生線性調(diào)頻信號(hào)的技術(shù)方法,并完成了邏輯開發(fā)和軟件仿真;同時(shí)基于SOPC系統(tǒng)在軟件處理上很好的靈活性,設(shè)計(jì)中利用了SOPC來完成波形產(chǎn)生器與PC機(jī)之間的數(shù)據(jù)通信、各種波形參數(shù)的解算以及對(duì)各種波形產(chǎn)生的控制切換。
在完成了上述
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