DDS-PLL低相噪低雜散頻綜研究.pdf_第1頁
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文檔簡介

1、本文介紹了一種低相噪低雜散頻率源的設計方法，并給出了最終測試所得的系統(tǒng)性能指標。 設計中混合使用了直接數(shù)字頻率合成(DDS)技術和鎖相環(huán)(PLL)技術，DDS提供PLL的參考輸入信號，PLL中的鑒相器芯片內集成有數(shù)字可編程的預分頻器和分頻器，通過單片機可以方便地對兩者進行程序控制。該結構綜合了DDS和PLL兩者的優(yōu)點，同時又在很大程度上克服了兩者的缺點，很好地滿足了課題的設計需要。 選用DDS激勵PLL方案是本課題成功的

2、重要保證，用此方案設計的頻率源最終達到了以下技術指標：輸出頻率范圍為637～701MHz，頻率步進為0.5MHz，跳頻周期為20μs，跳頻過渡時間為5μs，相位噪聲為-110d=Bc/Hz@10kHz，雜散優(yōu)于-70dBc。以上單個指標并不高，因為合理選用DDS技術或PLL技術可以將某個指標做得甚至更高，但綜合起來就形成了一個很高的整體技術指標，因為要想同時滿足所有指標，需要在一個系統(tǒng)里同時使用DDS技術與PLL技術，而兩者混合使用的方

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