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文檔簡介
1、AES算法是一種分組密碼算法，具有極高的安全性能，自提出之日起便成為信息安全領域研究的熱點。由于該算法在實現(xiàn)方面具有設計簡單，速度快，可并行處理，分組長度可以改變，對處理器結構無特殊要求，不涉及復雜數(shù)學運算等特性，使得其選用FPGA實現(xiàn)具有極大的優(yōu)越性?？墒侨绾卧O計，使得該算法在FPGA中運行速度更快，占用資源更少，功耗更低一直是擺在國內外學者面前的問題，目前并沒有統(tǒng)一的定論。 本文針對以上目標，研究了采用FPGA實現(xiàn)AES算法
2、的模型改進方法。將算法中密鑰擴展的處理采用FPGA以外的微控制器單片機配合完成，同時采用共享技術實現(xiàn)算法中加密和解密模塊共享同一密鑰。對于加密和解密模塊的設計，從結構上采用基本結構以節(jié)省資源，從各個運算步驟上采用數(shù)據(jù)并行處理，查表等方法以提高運算速度。改進的結果非但滿足了實時性的要求，且大大節(jié)省了FPGA資源，降低了功耗，為在低端小容量FPGA器件中實現(xiàn)實時AES算法的目標提供了重要的設計參考依據(jù)。并且，由于該算法電路數(shù)據(jù)端口長度最小也
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